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瓷砖之间的GTP时钟如何实现共享?
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Virtex
UG196的第83页注1,Virtex-5
FPGA
Rocke
ti
O GTP收发器用户指南,2.1版,“采购GTP_DUAL磁贴上方的GTP_DUAL磁贴数量不得超过3个”。
如果我有LX110,则有8个GTP图块。
这是否意味着我无法从一个瓷砖的REFCLK中获取时钟,因为不可能避免上面三个以上的瓷砖或下面三个以上的瓷砖?
例如,如果我选择图块112作为我的REFCLK源,则上面有三个图块,116,120和124,下面有四个图块,114,118,122和126。
谢谢,
杰夫
回帖
(3)
杨玲
2020-6-4 12:12:49
在时钟源上方或下方有四个或更多个区块是可以的。
你刚才
实际上无法将时钟连接到超过三个磁贴的那些磁贴
远。
如果您需要将时钟应用于7个以上的图块,则需要缓冲
它并将其应用于多个参考时钟输入。
- Gabor
- Gabor
在时钟源上方或下方有四个或更多个区块是可以的。
你刚才
实际上无法将时钟连接到超过三个磁贴的那些磁贴
远。
如果您需要将时钟应用于7个以上的图块,则需要缓冲
它并将其应用于多个参考时钟输入。
- Gabor
- Gabor
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刘嵩
2020-6-4 12:20:00
是的,你正确地理解了这一点。
在V-5中,您可以使用单个REFCLK输入获取的双瓦片的最大数量为7(上面3个,refclk进入1个瓦片,下面3个瓦片)。
如果你有8个瓷砖需要提供refclk,你需要至少2个参考时钟。
是的,你正确地理解了这一点。
在V-5中,您可以使用单个REFCLK输入获取的双瓦片的最大数量为7(上面3个,refclk进入1个瓦片,下面3个瓦片)。
如果你有8个瓷砖需要提供refclk,你需要至少2个参考时钟。
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周静
2020-6-4 12:30:51
好的,谢谢你的回复。
我完全按字面意思阅读文档,所以当它只说明上下瓷砖的数量不能超过三个而不是一个REFCLK来源的瓷砖数量不能超过上下三个时,我需要澄清。
问题解决了。
- 杰夫
好的,谢谢你的回复。
我完全按字面意思阅读文档,所以当它只说明上下瓷砖的数量不能超过三个而不是一个REFCLK来源的瓷砖数量不能超过上下三个时,我需要澄清。
问题解决了。
- 杰夫
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