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Altera可重配置PLL使用手册

Altera可重配置PLL使用手册

在实际应用中，FPGA的工作时钟频率可能在几个时间段内变动，对于与之相关的锁相环（PLL），若PLL的输入时钟在初始设定的时钟频率的基础上变化不太大时，PLL一般可以自己调整过来，并重新锁定时钟，获得正确的时钟输出；但是，若PLL的输入时钟频率较之原来设定的时钟频率变化较大时（比如，PLL输入时钟频率由50MHz变为200MHz），PLL将无法重新锁定时钟，其输出时钟频率将变为不确定的值。

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回帖（41）

crusade1981

2010-1-18 10:38:58

真的是非常有用的好东西呀

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mailtoyj

2010-1-19 17:21:57

好东西，看看

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zhangshan

2010-2-25 11:46:07

呵呵

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zhongrg

2010-2-25 16:27:04

需要，谢谢

需要，谢谢

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baoxiao

2010-3-5 17:57:24

谢谢楼主

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BlakeLively

2010-4-23 15:29:22

非常感谢

非常感谢正***

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luohuan928

2010-4-26 22:16:05

非常感谢 ,顶！！！

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开心笨笨

2010-5-9 22:42:19

谢楼主

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yangdingshe

2010-6-20 19:06:13

好东西正好不会弄呢

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baichongyan

2010-7-29 10:09:36

好东西啊，有用

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star11111

2010-8-5 22:14:49

zhen hao OK!

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xianzhao

2010-8-20 14:30:21

好东西，看看

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xianzhao

2010-8-20 14:31:10

下不了啊！

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hjq626

2010-8-21 22:42:23

下来看看！

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linhaiqing60

2010-9-26 15:04:25

xiankankan !!!!

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frankgqs

2010-10-31 21:10:57

hao dong xi

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thinkabout

2010-11-26 09:23:07

goodgoodgoodgoodgoodgoodgoodgood

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adsstpz123

2010-12-12 11:53:18

非常感谢 ,顶！！！

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derek_26

2010-12-12 21:28:46

rrrrrrrrrrrrrrrrrrrrrrrrrrrrrrrrrrrr

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