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[问答]

iMX6UL核心板CPU的ENET1_TX_CLK信号是可以配置成50Mhz时钟输出吗？

iMX6UL核心板和开发板之间的以太网RMII接口，将CPU的ENET1_TX_CLK信号直接连到PHY芯片（KSZ8081RNB）的X1管脚了，此处未使用外部时钟；
我有个疑问，这里CPU的ENET1_TX_CLK信号是可以配置成50Mhz时钟输出吗？

回帖（1）

张佳婧

2022-1-11 09:52:36

您好，是50M时钟

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